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结构体名称由设计者自由命名，是结构体的惟一名称。OF后面的实体名称表明该结构体属于哪个设计实体，有些设计实体中可能含有多个结构体。这些结构体的命名可以从不同侧面反映结构体的特色，让人一目了然。例如：
ARCHITECTURE behacvioral OF mux IS 用结构体行为命名
ARCHITECTURE dataflow OF mux IS 用结构体的数据流命名
ARCHITECTURE structural OF mux IS 用结构体的组织结构命名
ARCHITECTURE bool OF mux IS 用结构体的数学表达方式命名
ARCHITECTURE latch OF mux IS 用结构体的功能来定义
上述几个结构体都属于设计实体mux，每个结构体有着不同的名称，使得阅读VHDL程序的人能直接从结构体的描述方式了解功能，定义电路行为。因为用VHDL写的文档不仅是EDA工具编译的源程序，而且最初主要是项目开发文档，供开发商、项目承包人阅读的。这就是硬件描述语言与一般软件语言不同的地方之一。
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